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Ingeniero Líder de Verificación de Diseño – Protocolos de Interfaz de Alta Velocidad

Híbrido en Barcelona·Añadida hace 1 mes (comprobada el 3 nov)

Semidynamics

35 ofertas abiertas

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Nuestro resumen

Modalidad: Híbrido, Barcelona
Experiencia: 10+ años
Formación: Titulación universitaria

Habilidades

Se valora

Esta oferta se escribió originalmente en inglés.

Requisitos

Qué buscan

Grado o Máster en Ingeniería Eléctrica o Informática (o campo relacionado).
Más de 10 años de experiencia en verificación de diseño ASIC/SoC, con un enfoque reciente en protocolos de alta velocidad (PCIe, UCIe, SerDes).
Profunda experiencia en protocolos de bus on-chip (AXI, CXS, AHB, CHI, etc.).
Experiencia demostrada en el desarrollo de testbenches basados en UVM y en la gestión de flujos de sign-off basados en cobertura.
Sólido conocimiento de los fundamentos del diseño digital y microarquitecturas de SoC.
Competencia en Verilog/SystemVerilog y herramientas de simulación (VCS, Xcelium, Questa).
Habilidades excepcionales de depuración y resolución de problemas, con capacidad para trabajar de forma independiente en retos complejos.

Se valorará

Experiencia en el uso de herramientas asistidas por IA para la verificación de diseño y el análisis de regresión.
Familiaridad con sistemas de control de versiones (Git, Perforce) y frameworks de programación de tareas (LSF, Grid Engine).
Sólidas habilidades de scripting en Perl, Python o TCL para la automatización y flujos de trabajo de depuración.
Excelentes habilidades de comunicación y documentación.

Salario y beneficios

Qué ofrecen

Compensación y beneficios competitivos.

El puesto

Buscamos un Design Verification Engineer para liderar la verificación funcional a nivel de subsistema e IP de bloques de protocolos de interfaz de alta velocidad en nuestros chips de IA. Guiarás a un equipo de ingenieros de verificación altamente cualificados para entregar diseños con calidad de sign-off, colaborando estrechamente con los equipos de diseño RTL, arquitectura de SoC, firmware y otros equipos de verificación. Este es un rol de liderazgo práctico que requiere una profunda experiencia técnica y coordinación cross-functional.

Responsabilidades clave

Qué harás

Arquitecturar, configurar y depurar entornos de verificación funcional en múltiples bloques de diseño y niveles de subsistema.
Actuar como experto en protocolos, aportando claridad sobre los comportamientos esperados de AMBA e interfaces de alta velocidad (PCIe, UCIe, SerDes, etc.).
Depurar discrepancias entre RTL, modelos DV y especificaciones, garantizando la corrección funcional y el cumplimiento.
Desarrollar y mantener testbenches basados en UVM, scripts y flujos para automatizar los ciclos de compilación/ejecución de verificación.
Realizar el triaje y la búsqueda de la causa raíz de los fallos de simulación, realizar el seguimiento de errores e impulsar su resolución con equipos cross-functional.
Optimizar el tiempo de ejecución de la simulación, la capacidad y el tiempo de respuesta de compilación para diseños a gran escala.
Mantener documentación detallada de metodologías, flujos y problemas conocidos.

Cómo trabajarás

Modelo de trabajo híbrido: 4 días en la oficina de Barcelona (centro de la ciudad), 1 día de teletrabajo, además de 1 semana de "trabajar desde cualquier lugar".

Sobre Semidynamics

Sector: Tecnología

En sus propias palabras

Sobre la empresa y el equipo

Únete a una de las startups de semiconductores deep-tech más prometedoras de Europa, construyendo chips de IA desde el silicio hasta los sistemas.
Crecimiento profesional acelerado y responsabilidad técnica.
Un entorno colaborativo y orientado a la tecnología que valora la claridad, la responsabilidad y la innovación.

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